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    本發明之MOSFET(1)之製造方法包括如下步驟：將雜質導入至碳化矽層(10)；自導入有雜質之碳化矽層(10)之表層部選擇性地去除矽，藉此於表層部形成碳層(81)；及加熱形成有碳層(81)之碳化矽層(10)，藉此使上述雜質活化。
    公开号:TW201308443A
    申请号:TW101124529
    申请日:2012-07-06
    公开日:2013-02-16
    发明作者:Takeyoshi Masuda；Tomoaki Hatayama
    申请人:Sumitomo Electric Industries；Nat Univ Corp Nara Inst；
    IPC主号:H01L29-00
    专利说明:
    半導體裝置之製造方法
    本發明係關於一種半導體裝置之製造方法，更特定而言，本發明係關於一種可一面更確實地保護表面一面實施活化退火之半導體裝置之製造方法。
    近年來，為了使半導體裝置之高耐壓化、低損耗化、及高溫環境下之使用等成為可能，作為構成半導體裝置之材料，正在推進碳化矽之採用。與一直以來被廣泛用作構成半導體裝置之材料之矽相比，碳化矽係帶隙較大之寬帶隙半導體。因此，藉由採用碳化矽作為構成半導體裝置之材料而可達成半導體裝置之高耐壓化、導通電阻之降低等。又，與採用矽作為材料之半導體裝置相比，採用碳化矽作為材料之半導體裝置亦具有於高溫環境下使用時之特性之降低較小之優點。
    將此種碳化矽用作材料之半導體裝置之製造製程中，有時採用如下步驟：藉由離子注入等而將雜質導入至碳化矽層中，其後藉由實施活化退火而形成導電型與周圍區域不同之區域。而且，該活化退火係以超過1500℃之高溫實施。因此，自抑制表面粗糙等之觀點出發，提出於表面沈積有保護膜之狀態下實施退火之製程(例如，參照日本專利特開2001-68428號公報(專利文獻1)及日本專利特開2005-353771號公報(專利文獻2))。 [先行技術文獻] [專利文獻]
    [專利文獻1]日本專利特開2001-68428號公報
    [專利文獻2]日本專利特開2005-353771號公報
    然而，於在碳化矽層上配置有與碳化矽為不同材質之保護膜之情形時，有因碳化矽層與保護膜之線膨脹係數之差等而引起於活化退火之升溫過程中於保護膜產生斷裂等缺陷之虞。其結果，可能產生碳化矽層之表面未受到充分保護之問題。
    本發明係為了應對上述問題而完成者，其目的在於提供一種可一面更確實地保護表面一面實施活化退火之半導體裝置之製造方法。
    本發明之半導體裝置之製造方法包括如下步驟：將雜質導入至碳化矽層；自導入有雜質之碳化矽層之表層部選擇性地去除矽，藉此於表層部形成碳層；及加熱形成有碳層之碳化矽層，藉此使雜質活化。
    本發明之半導體裝置之製造方法中，自碳化矽層之表層部選擇性地去除矽，藉此於表層部形成作為保護膜而發揮功能之碳層。即，藉由自碳化矽層之表層部去除矽而使該表層部變質為作為保護膜之碳層。因此，與在碳化矽層上重新形成保護膜之先前之製程相比，可抑制因碳化矽層與保護膜之線膨脹係數之差等而引起之保護膜斷裂等缺陷。其結果，根據本發明之半導體裝置之製造方法，可一面更確實地保護表面一面實施活化退火。
    此處，所謂自碳化矽層之表層部選擇性地去除矽之狀態，係指與構成碳化矽之碳原子相比矽原子較多地脫離之狀態，本發明中較佳為矽原子以碳原子之10倍以上之比例脫離。
    上述半導體裝置之製造方法中，於形成碳層之步驟中，亦可藉由使鹵元素與矽反應而選擇性地去除矽。藉此，可使矽效率良好地脫離。
    上述半導體裝置之製造方法中，於形成碳層之步驟中，亦可於包含含有鹵元素之氣體之環境中加熱碳化矽層，藉此選擇性地去除矽。又，於上述半導體裝置之製造方法中，亦可於形成碳層之步驟中，將碳化矽層保持於含有鹵元素之電漿中，藉此選擇性地去除矽。
    根據上述方法，可較容易地藉由使用鹵元素去除矽而達成碳膜之形成。此處，作為含有鹵元素之氣體，可採用例如氯(Cl2)氣、氟(F2)氣、溴(Br2)氣、碘(I2)氣、氯化氫(HCl)氣體、三氯化硼(BCl3)氣體、六氟化硫(SF6)氣體、四氟化碳(CF4)氣體等。又，作為含有鹵元素之電漿，可採用例如含有選自由氯(Cl)、氟(F)、溴(Br)、碘(I)組成之群中之1種以上之元素的電漿。
    上述半導體裝置之製造方法中，亦可更包括於使雜質活化之步驟之後，將碳層氧化而去除之步驟。藉此，可容易地去除碳層。再者，於碳層去除後必需實施碳化矽層之犧牲氧化、或閘極氧化之情形時，亦可與上述將碳層經氧化而去除同時地實施該等處理。更具體而言，例如藉由於含氧之環境中實施加熱之熱處理而去除碳層，並維持原樣地於含氧之環境中保持碳化矽層，藉此實施犧牲氧化、閘極氧化等之碳化矽層之表面氧化處理。
    上述半導體裝置之製造方法中，於使雜質活化之步驟中，可將碳化矽層加熱至1600℃以上且1900℃以下之溫度域。藉此，可使所導入之雜質充分活化。而且，即便於已實施上述高溫之熱處理之情形時，藉由本發明之半導體裝置之製造方法中所形成之碳膜，亦可充分地保護碳化矽層之表層部。
    由以上說明而明確瞭解，根據本發明之半導體裝置之製造方法，可一面更確實地保護表面一面實施活化退火。
    以下，根據圖式說明本發明之實施形態。再者，以下之圖式中對於相同或相當之部分標示相同之參照符號，不重複其說明。又，本說明書中，分別以[ ]表示個別方位，以< >表示集合方位，以( )表示個別面，以{ }表示集合面。又，關於負指數，於結晶學上，將「-」(橫槓)附加於數字上，但本說明書中，於數字之前附加負號。
    首先，作為本發明之一實施形態，對半導體裝置即溝槽型MOSFET(Metal Oxide Semiconductor Field Effect Transistor，金屬氧化物半導體場效電晶體)及其製造方法進行說明。參照圖1，MOSFET1包括：導電型為n型(第1導電型)之碳化矽基板11；包含碳化矽且導電型為n型之漂移層12；導電型為p型(第2導電型)之p型主體區域14；導電型為n型之n+區域15；及導電型為p型之p+區域16。碳化矽基板11、漂移層12、p型主體區域14、n+區域15及p+區域16構成碳化矽層10。
    漂移層12形成於碳化矽基板11之一主面11A上，藉由含有n型雜質而使導電型成為n型。漂移層12中所含之n型雜質例如為N(氮)，且以較碳化矽基板11中所含之n型雜質低之濃度(密度)而含有。漂移層12係形成於碳化矽基板11之一主面11A上之磊晶成長層。漂移層12於與碳化矽基板11之界面附近，亦可包含提高了雜質濃度之緩衝層。
    於碳化矽層10形成有溝槽19，其具有自與碳化矽基板11側為相反側之主面10A朝碳化矽基板11側寬度逐漸變窄之錐形狀，且具有沿主面11A延伸之平坦之底部。溝槽19之側壁亦可以相對於構成碳化矽層10之碳化矽之{0001}面而成45°以上且90°以下之角度的方式形成。
    p型主體區域14以於碳化矽層10內包含溝槽19之側壁(構成溝槽19之側壁之一部分)，並且朝向自該溝槽19之側壁離開之方向沿主面11A延伸之方式形成。p型主體區域14藉由含有p型雜質而使導電型成為p型。p型主體區域14中含有之p型雜質例如為Al(鋁)、B(硼)等。
    n+區域15以於碳化矽層10內包含溝槽19之側壁，並且填充於p型主體區域14與主面10A之間(自p型主體區域14至主面10A)之方式形成。亦即，n+區域15以與p型主體區域14接觸、並且包含溝槽19之側壁及主面10A之方式形成。n+區域15以較漂移層12中所含之n型雜質高之濃度(密度)而含有n型雜質、例如P(磷)等。
    p+區域16以包含上述主面10A、且鄰接(接觸)於n+區域15之方式形成於碳化矽層10之內部。p+區域16以較p型主體區域14中所含之p型雜質高之濃度(密度)而含有p型雜質、例如Al等。上述溝槽19係以貫通n+區域15及p型主體區域14而到達漂移層12之方式形成。
    進而，參照圖1，MOSFET1包括作為閘極絕緣膜之閘極氧化膜21、閘極電極23、源極接觸電極22、層間絕緣膜24、源極配線25、汲極電極26、及背面保護電極27。
    閘極氧化膜21係以覆蓋溝槽19之表面、並且延伸至主面10A上為止之方式而形成，且包含例如二氧化矽(SiO2)。
    閘極電極23以填充溝槽19之方式接觸配置於閘極氧化膜21。閘極電極23包含例如添加有雜質之多晶矽、Al等之導電體。
    源極接觸電極22藉由自n+區域15上延伸至p+區域16上為止而接觸配置於n+區域15及p+區域16。又，源極接觸電極22包含例如NixSiy(矽化鎳)、TixSiy(矽化鈦)、AlxSiy(矽化鋁)、或TixAlySiz(矽化鋁鈦)等可與n+區域15及p+區域16歐姆接觸之材料。
    層間絕緣膜24以於碳化矽層10之主面10A上與閘極氧化膜21一併包圍閘極電極23，將閘極電極23、源極接觸電極22及源極配線25分離之方式形成，且包含例如作為絕緣體之二氧化矽(SiO2)。
    源極配線25以於碳化矽層10之主面10A上覆蓋層間絕緣膜24及源極接觸電極22之表面之方式形成。又，源極配線25包含Al等導電體，且經由源極接觸電極22而與n+區域15電性連接。
    汲極電極26係於碳化矽基板11上接觸而形成於與形成有漂移層12之側為相反側之主面11B。該汲極電極26包含可與碳化矽基板11歐姆接觸之材料，例如包含與上述源極接觸電極22相同之材料，且與碳化矽基板11電性連接。
    背面保護電極27係以覆蓋汲極電極26之方式而形成，且包含例如作為導電體之Al等。
    其次，對MOSFET1之動作進行說明。參照圖1，於閘極電極23之電壓未滿閾值電壓之狀態、即斷開狀態下，即便對汲極電極26與源極接觸電極22之間施加電壓，p型主體區域14與漂移層12之間之pn接面亦成為反向偏壓，成為非導通狀態。另一方面，若對閘極電極23施加閾值電壓以上之電壓，則於p型主體區域14之與閘極氧化膜21接觸之部位附近即通道區域形成反轉層。其結果，n+區域15與漂移層12電性連接，且於源極接觸電極22與汲極電極26之間流過電流。
    其次，參照圖2~圖10對本實施形態之MOSFET1之製造方法之一例進行說明。參照圖2，本實施形態之MOSFET1之製造方法中，首先作為步驟(S10)，實施碳化矽基板準備步驟。該步驟(S10)中，參照圖3，準備例如包含4H型六方晶碳化矽之碳化矽基板11。
    其次，作為步驟(S20)，實施漂移層形成步驟。該步驟(S20)中，參照圖3，於碳化矽基板11之一主面11A上藉由磊晶成長而形成包含碳化矽之漂移層12。
    其次，作為步驟(S30)，實施主體區域形成步驟。該步驟(S30)中，參照圖3及圖4，例如藉由將Al離子注入至漂移層12而形成p型主體區域14。此時，p型主體區域14於圖4中形成為使p型主體區域14及n+區域15之厚度相加之厚度。
    其次，作為步驟(S40)，實施源極接觸區域形成步驟。該步驟(S40)中，參照圖4，於步驟(S30)中所形成之p型主體區域14上，藉由注入例如P離子而形成n+區域15。其結果，獲得圖4所示之構造。
    其次，作為步驟(S50)，實施溝槽形成步驟。該步驟(S50)中，使用例如於所需之區域上具有開口之包含二氧化矽之遮罩，藉由RIE(Reactive Ion Etching，反應性離子蝕刻)等乾式蝕刻、或使用有鹵系氣體之熱蝕刻、或者其等之組合等之方法而形成溝槽19。具體而言，參照圖4及圖5，形成於n+區域15上具有開口之遮罩之後，形成貫通n+區域15及p型主體區域14、並且於沿碳化矽基板11之主面11A之方向(圖5中紙面向內方向)而延伸之溝槽19。此時，亦可以使自溝槽之側壁露出之p型主體區域14及n+區域15之表面相對於{0001}面之偏離角成為45°以上且90°以下之方式而形成溝槽19。
    其次，作為步驟(S60)，實施電位保持區域形成步驟。該步驟(S60)中，參照圖5及圖6，於步驟(S50)中所形成之n+區域15上，藉由注入例如Al離子而形成p+區域16。用以形成該p+區域16之離子注入係可於例如n+區域15之表面上形成包含二氧化矽(SiO2)、且於應實施離子注入之所需之區域上具有開口之遮罩層而實施。藉此，完成構成MOSFET1之碳化矽層10。
    其次，作為步驟(S70)，實施碳層形成步驟。該步驟(S70)中，藉由自碳化矽層10之表層部選擇性地去除矽而於該表層部形成碳層。具體而言，參照圖6及圖7，例如可藉由使鹵元素與構成碳化矽層10之矽反應而選擇性地去除矽。經與鹵元素反應而選擇性地去除矽係可藉由例如於包含含有鹵元素之氣體之環境中加熱之處理而達成，亦可藉由保持於含有鹵元素之電漿中之處理而達成。藉此，自溝槽19之底壁及側壁、以及包含n+區域15及p+區域16之上部表面之表面層選擇性地去除矽，該表面層變質為碳層81。以此方式，形成作為退火覆蓋層而發揮功能之碳層81。
    此處，碳層81之厚度可形成為例如0.01 μm以上且1.0 μm以下之程度。又，於藉由於包含含有鹵元素之氣體之環境中加熱之處理而形成碳層81之情形時，例如於包含氯氣及氟氣之環境中加熱至800℃以上且1200℃以下之溫度域，並保持1分鐘以上且未滿60分鐘之時間，藉此可形成碳層81。又，於藉由保持於含有鹵元素之電漿中之處理而形成碳層81之情形時，適當地設定電漿功率或反應氣體之壓力條件，藉此可形成碳層81。所形成之碳層81較佳為具有石墨構造、鑽石構造、或DLC(Diamond Like Carbon，類鑽碳)構造。
    其次，作為步驟(S80)，實施活化退火步驟。該步驟(S80)中，藉由加熱上述碳化矽層10而使於步驟(S30)、(S40)及(S60)中所導入之雜質活化。具體而言，如圖7所示於形成有碳層81之狀態下，將碳化矽層10加熱至例如1600℃以上且1900℃以下之溫度域，並保持1分鐘以上且30分鐘以下。藉此，於導入有雜質之區域上生成所需之載子。
    其次，作為步驟(S90)，實施碳層去除步驟。該步驟(S90)中，例如將步驟(S70)中所形成之碳層81藉由氧化而去除。具體而言，例如於含氧之環境中實施加熱之熱處理，藉此去除碳層81。經該氧化處理而去除碳層81係可與碳化矽層10之犧牲氧化處理、或下述閘極氧化膜之形成同時地實施，或者連續地實施。
    其次，作為步驟(S100)，實施閘極氧化膜形成步驟。該步驟(S100)中，參照圖8，例如於氧環境中實施加熱至1300℃並保持60分鐘之熱處理，藉此形成閘極氧化膜21。
    其次，作為步驟(S110)，實施閘極電極形成步驟。該步驟(S110)中，參照圖9，例如藉由LPCVD(Low Pressure Chemical Vapor Deposition，低壓化學氣相沈積)法而形成填充於溝槽19中之多晶矽膜。藉此，形成閘極電極23。
    其次，作為步驟(S120)，實施層間絕緣膜形成步驟。該步驟(S120)中，參照圖9及圖10，例如藉由P(Plasma，電漿)-CVD(Chemical Vapor Deposition，化學氣相沈積)法，以覆蓋閘極電極23及閘極氧化膜21之方式而形成包含絕緣體SiO2之層間絕緣膜24。
    其次，作為步驟(S130)，實施歐姆電極形成步驟。該步驟(S130)中，參照圖10，首先於應形成源極接觸電極22之所需之區域上，形成貫通層間絕緣膜24及閘極氧化膜21之孔部。然後，以填充於該孔部之方式而形成例如包含Ni之膜。另一方面，於碳化矽基板11上以與漂移層12之側為相反側之主面接觸之方式，形成應成為汲極電極26之膜、例如包含Ni之膜。其後，實施合金加熱處理，使包含上述Ni之膜之至少一部分矽化，藉此完成源極接觸電極22及汲極電極26。
    其次，作為步驟(S140)，實施配線形成步驟。該步驟(S140)中，參照圖10及圖1，例如藉由蒸鍍法，於主面10A上，以覆蓋層間絕緣膜24及源極接觸電極22之上部表面之方式而形成包含導電體Al之源極配線25。進而，同樣地以覆蓋汲極電極26之方式而形成包含Al之背面保護電極27。藉由以上順序，完成作為本實施形態之半導體裝置之MOSFET1之製造方法。
    上述實施形態之MOSFET1之製造方法中，於步驟(S70)中自碳化矽層10之表層部選擇性地去除矽，藉此形成作為保護膜(退火覆蓋層)而發揮功能之碳層81。該碳層81並非係於碳化矽層10上沈積新的層而形成者，而是藉由使表層部變質而形成者，故而不易因保護層與碳化矽層之線膨脹係數之差等而引起斷裂等。又，碳層81係以上述製程而形成，故而如上述實施形態般較容易以覆蓋具有形成有溝槽之複雜形狀之表面之方式而形成碳層81。其結果，根據本實施形態之MOSFET1之製造方法，可一面更確實地保護表面一面實施步驟(S80)之活化退火。
    再者，於上述實施形態中，已對溝槽型之MOSFET之製造方法進行了說明，但本發明之半導體裝置之製造方法並不限於此，例如亦可應用於平面型之MOSFET之製造方法。進而，本發明之半導體裝置之製造方法不僅可應用於MOSFET，而且可廣泛應用於JFET(Junction Field Effect Transistor，接面場效電晶體)、IGBT(Insulated Gate Bipolar Transistor，絕緣閘雙極電晶體)、二極體等之包含使導入至碳化矽層中之雜質活化退火之製程的半導體裝置之製造方法。
    當認為，此次揭示之實施形態之所有點均為例示，而非限制性者。本發明之範圍係藉由申請專利範圍而非上述之說明而揭示，並試圖包含與申請專利範圍均等之意義、及範圍內之所有變更。 [產業上之可利用性]
    本發明之半導體裝置之製造方法可特別有利地應用於要求一面充分地保護碳化矽層之表面一面實施活化退火之半導體裝置之製造。
    1‧‧‧MOSFET
    10‧‧‧碳化矽層
    10A‧‧‧主面
    11‧‧‧碳化矽基板
    11A、11B‧‧‧主面
    12‧‧‧漂移層
    14‧‧‧p型主體區域
    15‧‧‧n+區域
    16‧‧‧p+區域
    19‧‧‧溝槽
    21‧‧‧閘極氧化膜
    22‧‧‧源極接觸電極
    23‧‧‧閘極電極
    24‧‧‧層間絕緣膜
    25‧‧‧源極配線
    26‧‧‧汲極電極
    27‧‧‧背面保護電極
    81‧‧‧碳層
    S10~S140‧‧‧步驟
    圖1係表示MOSFET之構造之概略剖面圖。
    圖2係表示MOSFET之概略製造方法之流程圖。
    圖3係用以說明MOSFET之製造方法之概略剖面圖。
    圖4係用以說明MOSFET之製造方法之概略剖面圖。
    圖5係用以說明MOSFET之製造方法之概略剖面圖。
    圖6係用以說明MOSFET之製造方法之概略剖面圖。
    圖7係用以說明MOSFET之製造方法之概略剖面圖。
    圖8係用以說明MOSFET之製造方法之概略剖面圖。
    圖9係用以說明MOSFET之製造方法之概略剖面圖。
    圖10係用以說明MOSFET之製造方法之概略剖面圖。
    10‧‧‧碳化矽層
    11‧‧‧碳化矽基板
    12‧‧‧漂移層
    14‧‧‧p型主體區域
    15‧‧‧n+區域
    16‧‧‧p+區域
    19‧‧‧溝槽
    81‧‧‧碳層
    权利要求:
    Claims (6)
    [1] 一種半導體裝置(1)之製造方法，其包括如下步驟：將雜質導入至碳化矽層(10)；自導入有上述雜質之上述碳化矽層(10)之表層部選擇性地去除矽，藉此於上述表層部形成碳層(81)；及加熱形成有上述碳層(81)之上述碳化矽層(10)，藉此使上述雜質活化。
    [2] 如請求項1之半導體裝置(1)之製造方法，其中於形成上述碳層(81)之步驟中，藉由使鹵元素與矽反應而選擇性地去除矽。
    [3] 如請求項2之半導體裝置(1)之製造方法，其中於形成上述碳層(81)之步驟中，於包含含有鹵元素之氣體之環境中加熱上述碳化矽層(10)，藉此選擇性地去除矽。
    [4] 如請求項2之半導體裝置(1)之製造方法，其中於形成上述碳層(81)之步驟中，將上述碳化矽層(10)保持於含有鹵元素之電漿中，藉此選擇性地去除矽。
    [5] 如請求項1或2之半導體裝置(1)之製造方法，其中更包括於使上述雜質活化之步驟之後，將上述碳層(81)氧化而去除之步驟。
    [6] 如請求項1或2之半導體裝置(1)之製造方法，其中於使上述雜質活化之步驟中，將上述碳化矽層(10)加熱至1600℃以上且1900℃以下之溫度域。
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    同族专利:
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    法律状态:
    优先权:
    申请号 | 申请日 | 专利标题
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